fpga/cpld實驗報告
實驗題目： 波形發生器
班級： 控制研-12
姓名：學號：
一、實驗名稱：波形發生器
2、實驗內容：用vhdl語言實現波形發生器。
3、實驗設計：
. 開啟quartus ii軟體，先新建乙個vhdl file檔案。
. 輸入源程式，點選儲存，檔名要與實體名一樣，本實驗的實體名為boxing。
. 儲存完後，對檔案進行編譯。
. 編譯通過後，選擇file裡的create/update選項裡的create symbol files for current file，此時quartus ii軟體自動生成數碼管掃瞄電路的硬體電路圖。
. 新建乙個block diagram/schematic file檔案。雙擊空白處，會自動出現project檔案，檔案下面會出現名為boxing的器件，選擇並點選ok。
. 連線上輸入輸出，儲存，並編譯此檔案。
. 在選單欄中的processing裡選擇simulator tool，然後在simulator mode裡選擇functional後，點選generate functional simulation netlist，進行編譯。編譯完後再新建乙個vector w**eform file檔案，點選空白處，選擇note finder，在filter裡選擇pins：
all,再點選list，把所有引腳匯入。然後選擇個輸入引腳的時鐘訊號。儲存。
. 儲存完後，在選單欄中的processing裡選擇simulator tool，點選start，進行**，最後輸出波形，驗證正確性。如不正確，改正錯誤後，重新進行**設計，直到排除錯誤。
4、實驗源程式及原理圖：
源程式：
library ieee;
useuseuseentity boxing is
port (
clk: in std_logic;
reset: in std_logic;
mode: in std_logic_vector (1 downto 0);
d_out: out std_logic_vector (7 downto 0)
);end boxing;
architecture boxing_arch of boxing is
signal da : std_logic_vector(7 downto 0);
begin
-- <>
process(clk,reset,mode,da)
variable **** : std_logic;
begin
if reset='0' then
da<="00000000";
d_out<="00000000";
****:='0';
else
if clk='1' and clk'event then
case mode is
when "00" =>
if da<255 then
da<=da+1;
else
da<="00000000";
end if;
when "01" =>
if da=0 then
da<="11111111";
else
da<=da-1;
end if;
when "10" =>
if ****='0' then
if da<255 then
da<=da+1;
else
****:='1';
end if;
else
if da>0 then
da<=da-1;
else
****:='0';
end if;
end if;
when "11" =>
if da<240 then
da<=da+32;
else
da<="00000000";
end if;
when others =>
da<="00000000";
end case;
end if;
d_out<=da;
end if;
end process;
end boxing_arch;
硬體連線圖：
波形發生器硬體連線圖
五、實驗分析及總結：
當reset=0時，無論輸入為何值，輸出全為零，故reset為復位訊號。
當reset=1，mode（1,0）=00時，輸出為正斜率斜波；
正斜率斜波
當reset=1，mode（1,0）=01時，輸出為負斜率斜波：
負斜率斜波
負斜率斜波
當reset=1，mode（1,0）=10時，輸出為三角波：
三角波當reset=1，mode（1,0）=11時，輸出為遞增階梯波：
遞增階梯波
故，該波形發生器通過模式mode（1,0）的選擇實現正負斜率波、三角波哈遞增階梯波的選擇。
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