一、填空題（每小題△△分，共△△分）
（1）邏輯代數中的三種基本的邏輯運算是（與）運算、（或）運算和（非）運算。
（2）邏輯變數和邏輯函式的取值只有（0）和（1）兩種取值。它們表示兩種相反的邏輯狀態。
（3）與邏輯運算規則可以歸納為有0出 （0），全1出（1）。
（4）或邏輯運算規則可以歸納為有1出 （1），全0出（0）。
（5）與非邏輯運算規則可以歸納為有（0）出1，全（1）出0。
（6）或非邏輯運算規則可以歸納為有（1）出0，全（0）出1。
（7）二極體從導通到截止所需時間稱為（開通）時間。
（8）oc門是集電極（開路）門，使用時必須在電源vcc與輸出端之間外接（電阻）。
（9）在數位電路中，三極體工作在（飽和）狀態和（截止）狀態。
（10）三態輸出門輸出的三個狀態分別為（低電平）、（高電平）、（高阻態）。
（11）邏輯代數中三條重要的規則是（代入）規則、（對偶）規則和（反演）規則。
（12）化簡邏輯函式的主要方法有（代數）化簡法和（卡諾圖）化簡法。
（13）邏輯函式的表示方法主要有（函式表示式）、（真值表）、（邏輯）、卡諾圖和波形圖。
（31）編碼器按功能不同分為（二進位制）編碼器、（二-十進位制）編碼器和優先編碼器。
（32）解碼器按功能不同分為（二進位制）解碼器、（二-十進位制）解碼器和顯示解碼器。
（33）8選1資料選擇器在所有輸入資料都為1時，其輸出標準與或表示式共有（ 8 ）個最小項。
（34）輸入3位二進位制**的二進位制解碼器應有（ 8 ）個輸出端，共輸出（ 8 ）個最小項。
（35）共陽極led數碼管應由輸出（ 低 ）電平的七段顯示解碼器來驅動點亮。而共陰極led數碼管應由輸出（ 高 ）電平的七段顯示解碼器來驅動點亮。
（41）二進位制數是以（ 2 ）為基數的計數體制，十進位制數是以（ 10 ）為基數的計數體制，十六進製制是以（ 16 ）為計數體制。
（42）十進位制數轉換為二進位制數的方法是：整數部分用（除2取餘），小數部分用（乘2取整）法。
（43）二進位制數轉換為十進位制數的方法是（各位按權展開相加）。
（44）全加器有三個輸入端，它們分別為（被加數 ）、（ 加數 ）和相鄰低位進製；輸出端有兩個，分別為本位和、進製數。
（45）數值比較器的功能是比較兩組二進位制數的大小或相等的電路，當輸入a=1111和b=1101時，則它們比較得結果為（a>b ）。
（51）觸發器具有兩個穩定狀態，在外訊號作用下這（兩個穩定狀態）可相互轉換。
（52）邊沿jk觸發器具有（置0 ）、（ 置1 ）、（ 保持 ）和翻轉功能。
（55）在乙個cp脈衝作用下，引起觸發器兩次或多次翻轉的現象稱為觸發器的空翻，觸發方式為主從式或邊沿式的觸發器不會出現這種現象。
（61）對於時序邏輯電路來說，某時刻電路的輸出狀態不僅取決於該時刻的（輸入訊號），而且還取決電路的（原有狀態），因此，時序邏輯電路具有（記憶）性。
（62）時序邏輯電路由（組合邏輯）電路和（儲存）電路兩部分組成，（儲存）電路必不可少。
（63）計數器按進製分：有二進位制計數器、（ 十 ）進製計數器和任意進製計數器。
（64）整合計數器的清零方式分為（非同步置零）和（同步置零）；置數方式分為（同步置數）和（同步置數）。
（65）乙個4位二進位制加法計數器的起始計數狀態q3q2q1q0=1010，當最低位接收到4個計數脈衝時，輸出的（1110）。
（72）多諧振盪器沒有（穩定）狀態，只有兩個暫穩態狀態，其振盪週期t取決於（rc的值）。
（71）常見的脈衝產生電路有(多諧振盪器)，常見的脈衝整形電路有（單穩態觸發器）、（施密特觸發器）。
（73）施密特觸發器具有回差現象，又稱（電壓滯後）特性；單穩觸發器最重要的引數為（脈寬）。
（74）在由555定時器組成的多諧振盪器中，其輸出脈衝的週期t為（0.7（r1+r2）c））。
（75）在由555定時器組成的單穩態觸發器中，其輸出脈衝寬度tw為(1.1rc)。
（81）將模擬訊號轉換為數碼訊號，需要經過(採用)、（保持）、（量化）、（編碼）四個過程。
（82）d／a轉換器用以將輸入的二進位制**轉換為相應（模擬電壓）輸出的電路。
（83）r-2r 倒t型網路d／a轉換器主要由（電子模擬開關）、（基準電壓）、（r-2r倒t型電阻網路） 和（求和運算放大器）等部分組成。
（84）a／d轉換器從轉換過程看可分為兩類（直接a/d轉換器）和（間接a/d轉換器）兩類。
（85）a/d轉換器的位數越多，能分辨最小模擬電壓的值就（越小）。
二、判斷題（每小題△△分，共△△分；對的打「∨」，錯的打「×」）
（1）二極體可組成與閘電路，但不能組成或閘電路。（ × ）
（2）三態輸出門可實現「線與」功能。（ × ）
（3）二端輸入與非門的乙個輸入端接高電平時，可構成反相器。（ × ）
（4）74ls00是2輸入端4與非門。（ √ ）
（5）二端輸入或非門的乙個輸入端接低電平時，可構成反相器。（ √ ）
（21）邏輯函式的標準與－或表示式又稱為最小項表示式，它是唯一的。（ √ ）
（22）卡諾圖化簡邏輯函式的實質時合併相鄰最小項。（ √ ）
（23）因為，所以。( × )
（24）因為，所以。( × )
（25）邏輯函式又可以寫成。( √ )
（31）優先編碼器的編碼訊號是相互排斥的，不允許多個編碼訊號同時有效。（ × ）
（32）編碼與解碼是互逆的過程。（ √ ）
（33）二進位制解碼器相當於是乙個最小項發生器，便於實現組合邏輯電路。（√ ）
（34）共陰接法發光二極體數碼顯示器需選用有效輸出為高電平的七段顯示解碼器來驅動。（ √ ）
（35）資料選擇器和資料分配器的功能正好相反，互為逆過程。（ √ ）
（41）乙個n為二進位制數，最高位的權值是2n-1。（ √ ）
（42）十進位制數45的8421bcd碼是101101。（ × ）
（43）餘3bcd碼是用3位二進位制數表示一位十進位制數。（ × ）
（44）半加器只考慮1位二進位制數相加，不考慮來自低位的進製數。（ √ ）
（45）數值比較器是用於比較兩組二進位制數大小的電路。（ × ）
（51）rs觸發器的約束條件rs=0表示不允許出現r=s=1的輸入。（ √ ）
（52）主從jk觸發器、邊沿jk觸發器和同步jk觸發器的邏輯功能完全相同。（ √ ）
（53）對邊沿jk觸發器，在cp為高電平期間，當j=k=1時，狀態會翻轉一次。（ × ）
（54）若要實現乙個可暫停的一位二進位制計數器，控制訊號a=0計數，a=1保持，可選用t觸發器，且令t=a。（ × ）
（55）同步d觸發器在cp=1期間，d端輸入訊號變化時，對輸出q端沒有影響。（ × ）
（61）同步時序電路具有統一的時鐘cp控制。（ √ ）
（62）十進位制計數器由十個觸發器組成。（ √ ）
（63）非同步計數器的計數速度最快。（ × ）
（64）4位二進位制計數器也是乙個十六分頻電路。（ √ ）
（65）雙向移位暫存器可同時執行左移和右移功能。（ × ）
（71）施密特觸發器可用於將三角波變換成正弦波。（ × ）
（72）施密特觸發器有兩個穩態。（ √ ）
（73）多諧振盪器的輸出訊號的週期與阻容元件的引數成正比。（ √ ）
（74）石英晶體多諧振盪器的振盪頻率與電路中的r、c成正比。（ × ）
（75）單穩態觸發器的暫穩態時間與輸入觸發脈衝寬度成正比。（ × ）
（81）d/a轉換器的位數越多，轉換精度越高。（ √ ）
（82）雙積分型a/d轉換器的轉換精度高、抗干擾能力強，因此常用於數字式儀表中。（ √ ）
（3）取樣定理的規定是為了能不失真地恢復原模擬訊號，而又不使電路過於複雜。（ √ ）
（84）a / d 轉換器完成一次轉換所需的時間越小，轉換速度越慢。（ × ）
（85）a/d轉換器的二進位制數的位數越多，量化單位△越小。（ √ ）
三、單項選擇題（每小題△△分，共△△分，將對的序號填入括號內，每小題只有乙個選項是對的，多選無效）
（1）要使與門輸出恒為0，可將與門的乙個輸入端（ a ）。
a. 接0 b. 接1 c.接0、1都可以 d.輸入端併聯
（2）要使或門輸出恒為1，可將或門的乙個輸入端( b )。
a. 接0 b. 接1 c.接0、1都可以 d.輸入端併聯
（3）要使異或門成為反相器時，則另乙個輸入端應接( b )。
a. 接0 b. 接1 c.接0、1都可以 d.兩輸入端併聯
（4）集電極開路門（oc門）在使用時，輸出端通過電阻接( b )。
a. 地 b. 電源 c. 輸入端 d. 都不對
（5）以下電路中常用於匯流排應用的有( d )。
a. oc門 b. cmos與非門 c. 漏極開路門 d. tsl門
（21）指出下列各式中哪個是3變數abc的最小項（b）。
a． ab b. abc c. ac d. a+b
（22）邏輯項的邏輯相鄰項為( a )
a. b. c. d.
(23)實現邏輯函式需要用( b )
a. 兩個與非門 b. 三個與非門 c. 兩個或非門 d. 三個或非門
（24）使邏輯函式取值為1的變數取值是( c )
a. 001 b. 101 c. 011 d. 111
（25）函式與,( d )
a. 互為對偶式 b. 互為反函式 c. 相等 d. a、b、c都不對
（31）若在編碼器中有50個編碼物件，則要求輸出二進位制**位數為( b )位。
a.5 b.6 c.10 d.50
（32）乙個16選一的資料選擇器，其位址輸入（選擇控制輸入）端有( c )個。
a.1 b.2 c.4 d.16
（34）用四選一資料選擇器實現函式y=，應使( a )。
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