單項選擇題
在每小題列出的四個備選項中只有乙個是符合題目要求的，請將其**填寫在題後的括號內。錯選、多選或未選均無分。
1．n型雜質半導體中，多數載流子是( d)
a．正離子 b．負離子
c．空穴d．自由電子
2．理想二極體構成的電路如題2圖所示，則輸出電壓u0為(b )
a．-5v b．+5v
c．+10v d．+15v
3．測得電路中某晶體三極體(鍺管)各管腳的電位，如題3圖所示，則可判定該管處在( c)，
a．放大狀態 b．飽和狀態
c．截止狀態 d．不確定狀態
4．測得某放大狀態的晶體三極體，各管腳的電位如題4圖所示，則可判定該管為(b )
a．pnp型管，①是e極 b．pnp型管，③是e極
c．npn型管，①是e極 d．npn型管，②是e極
5．下列基本放大電路中，有電壓放大作用無電流放大作用的是( c)
a．共射極放大電路 b．共集電極放大電路
c．共基極放大電路 d. 共源極放大電路
6．為了使輸出電阻降低，在放大電路中應引入交流(c )
a．串聯負反饋 b．併聯負反饋
c．電壓負反饋 d．電流負反饋
7．已知某放大電路的電壓放大倍數為104，則該電壓放大倍數用分貝表示為(c )
a．40db b．60db
c．80db d．100db
8．邏輯函式f=a + c的最小項表示式為(a )
a．f(a，b，c)=∑m(1，3，4，5) b．f(a，b，c)=∑m(0，2，4，5)
c. f(a，b，c)=∑m(1，2，5，6) d．f(a，b，c)=∑m(1，3，5，6)
9．三位二進位制編碼器，可實現的編碼狀態為(c )
a．2個 b．4個
c．8個 d．12個
10．下列與或邏輯函式式f=abc+a 具有相同邏輯功能的為(b )
a．f=ab b．f=a
c．f=a( ) d．f=abc
11．邏輯電路14圖所示，其輸出函式表示式為(b )
a．f= a非
b．f=1
c．f=a
d．f=0
12．整合雙向移位暫存器74ls194應用電路如15圖，該電路初始狀態為q0q1q2q3=0001，則經過三個cp後，電路的狀態應為q0q1q2q3=(d )
a．0100 b．0001 c．1000 d．0010
填空題13．晶體三極體甲的 =200，icbo=10 a，晶體三極體乙的 =80，icbo=0.2 a，兩管比較，可判定是晶體**管______乙__的效能好。
14．放大電路中的負反饋有4種組態，若要求輸入電阻高，輸出電阻高，在放大電路中應引入_____電流串聯（或串聯電流）___負反饋。
15．電晶體v1的 =50，電晶體v2的 =30，若兩管組成復合電晶體，則該復合電晶體的p約為____1500____．
16．與十進位制數(31)d相對應的8421bcd碼為(_00110001_)8421bcd。
17．函式f=a +bc 的最簡與或表示式為f=__b+_____。
18．由主從jk觸發器構成的電路如23圖所示，此電路實現了______計數____功能。
1、數碼訊號的特點是在時間上和數值上都是斷續變化的，其高電平和低電平常用 1 和 0 來表示。
組合邏輯電路不存在輸出到輸入的＿＿＿反饋＿＿＿＿＿通路，因此其輸出狀態不影響輸入狀態。
3. 將十進位制數45轉換成8421碼可得 01000101
4.同步rs觸發器的特性方程為qn+1=___s+ qn _______；約束方程為＿r..s=0
＿＿＿＿＿＿＿＿。
5. 數位電路按照是否有記憶功能通常可分為兩類： 組合邏輯電路 、 時序邏輯電路
6.邏輯變數的異或表示式為：。
7．能將模擬訊號轉換成數碼訊號的電路，稱為 a/d而將能把數碼訊號轉換成模擬訊號的電路稱為d/a
8.組合電路沒有＿＿記憶＿＿＿＿功能，因此，它是由＿＿閘電路＿＿＿＿組成。
9. 兩片中規模積體電路10進製計數器串聯後，最大計數容量為 100 位。
10.將bcd碼翻譯成十個對應輸出訊號的電路稱為＿＿二—十進位制解碼器＿＿＿＿＿＿，它有＿4＿＿個輸入端，＿＿10＿＿個輸出端。
分析計算題
19．放大電路如25圖所示，知ucc=12v，rb=120k ，re=rl=4k ， =40，
ubeq =0.6v，rbe為已知
(1)指出該放大電路的名稱； (2)計算靜態量ieq、uceq； (3)寫出輸入電阻ri的表示式
20．理想運放構成的電路如27圖所示
(1)指出題27圖為何種運算電路；(2)寫出u0與ui的表示式；(3)計算平衡電阻r2；(4)指出電路中存在何種負反饋組態。
3、設主從jk觸發器的初始狀態為0，觸發器的觸發翻**生在時鐘脈衝的下降沿，已知輸入j、k的波形圖如圖5.1，（1）寫出jk觸發器的特性方程式；（2）畫出輸出q的波形圖。
設計題21．已知n為三位二進位制數(如n=abc)，設0≤n<6且為偶數時，輸出f=1，否則f=0，
試：(1)列出真值表；
(2)寫出邏輯表示式並化為最簡與或式；
(3)化為與非-與非式；
(4)畫出僅用與非門實現的邏輯電路圖(輸入變數允許有反變數)
22．用整合四位二進位制(十六進製制)加法計數器74ls161(t214)設計乙個七進製計數器。
(1)用反饋置數法( 端)設計組成電路，要求置數為d3d2d1d0=0010。
(2)確定反饋狀態。
(3)畫出計數環節的迴圈狀態圖。74ls161(t214)邏輯符號及功能表如題32圖和題32
表所示。
題32表
1．分析圖示觸發器功能，寫出其輸出端q1 、q2的表示式，並根據給定a、cp訊號的波形畫出各輸出端的波形。設各觸發器的初始狀態均為「0」。（10分）
2．四選一資料選擇器的功能見下表，要實現y（a，b，c）＝σm（1，4，6，7）功能，晶元應如何連線，畫出電路連線圖（需寫出必要的解題步驟）
3．ttl觸發器電路如圖所示，試在cp訊號的計數週期內，畫出各輸出端的波形。
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