EDA時鐘設計性報告

2021-09-11 23:12:54 字數 1496 閱讀 9860

計算機與資訊科技學院綜合性、設計性實驗報告

專業:通訊工程年級/班級: 2011—2012學年第一學期

一、 實驗目的

1. 進一步熟悉時鐘的程式設計實現方法;

2. 掌握利用eda軟體實現時鐘的基本原理;

3. 熟練使用quartus進行程式設計;

二、 實驗儀器或裝置

裝quartusii軟體的微機一台

三、 總體設計(設計原理、設計方案及流程等)

時鐘利用軟體實現時分別實現小時,分鐘,秒的計時,同時復位鍵按下時計時歸零。

五.**波形

六. 實驗步驟(包括主要步驟、**分析等)

module shizhong10(clk,clr,pause,sh,sl,mh,ml,hl,hh);

input clk,clr,pause;

output [3:0] sh,sl,mh,ml,hl,hh;

reg [3:0] sh,sl,mh,ml,hl,hh;

reg cn1,cn2;

always @(posedge clk or posedge clr)

begin

if(clr)

begin <=8'h00;cn1<=0;

endelse if(!pause)

begin

if(sl==9) begin sl<=0;

if(sh==5) begin sh<=0;

cn1<=1;

endelse sh<=sh+1;

endelse begin sl<=sl+1; cn1<=0;

endend

endalways @(posedge cn1 or posedge clr)

begin

if(clr)

begin <=8'h00;

cn2<=0;

endelse if(ml==9)

begin ml<=0;

if(mh==5)

begin mh<=0;

cn2<=1;

endelse mh<=mh+1;

endelse begin ml<=ml+1; cn2<=0;

endend

always @(posedge cn2 or posedge clr)

begin if(clr)

begin <=8'h00;

endelse if(hl==3&&hh==2)

begin <=8'h00;<=8'h00;end

else if(hl==9) begin hl<=0;

if(hh==2) hh<=0;

else hh<=hh+1;

endelse hl<=hl+1;

endendmodule

七、結果分析與總結

通過本實驗我進一步學習和了解了eda軟體,並加深了對它的進一步了解,使我在以後的學習中更有方向性,我會進一步努力的,同時發現自身也存在很大不足,但是我會進一步加強練習的。

教師簽名:年月日

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