《eda技術與專案訓練》選擇題
1. 乙個專案的輸入輸出埠是定義在 a 。
a. 實體中 b. 結構體中 c. 任何位置 d. 程序體
2. 描述專案具有邏輯功能的是 b 。
a. 實體b. 結構體 c. 配置d. 程序
3. 關鍵字architecture定義的是 a 。
a. 結構體 b. 程序 c. 實體d. 配置
4. maxplusii中編譯vhdl源程式時要求 c 。
a.檔名和實體可不同名 b.檔名和實體名無關 c. 檔名和實體名要相同 d. 不確定
5. 1987標準的vhdl語言對大小寫是 d 。
a. 敏感的 b. 只能用小寫 c. 只能用大寫 d. 不敏感
6. 關於1987標準的vhdl語言中，識別符號描述正確的是 a 。
a. 必須以英文本母開頭 b.可以使用漢字開頭 c.可以使用數字開頭 d.任何字元都可以
7. 關於1987標準的vhdl語言中，識別符號描述正確的是 b 。
a. 下劃線可以連用 b. 下劃線不能連用 c. 不能使用下劃線 d. 可以使用任何字元
8. 符合1987vhdl標準的識別符號是 a 。
a. a_2b. a+2 c. 2ad. 22
9. 符合1987vhdl標準的識別符號是 a 。
a. a_2_3b. a_____2 c. 2_2_ad. 2a
10. 不符合1987vhdl標準的識別符號是 c 。
a. a_1_inb. a_in_2 c. 2_ad. asd_1
11. 不符合1987vhdl標準的識別符號是 d 。
a. a2b2b. a1b1 c. ad12d. %50
12. vhdl語言中變數定義的位置是 d
a. 實體中中任何位置 b. 實體中特定位置 c. 結構體中任何位置 d. 結構體中特定位置
13. vhdl語言中訊號定義的位置是 d 。
a. 實體中任何位置 b. 實體中特定位置 c. 結構體中任何位置 d. 結構體中特定位置
14. 變數是區域性量可以寫在 b 。
a. 實體中b. 程序中 c. 線粒體d. 種子體中
15. 變數和訊號的描述正確的是 a
a. 變數賦值號是:= b. 訊號賦值號是:= c. 變數賦值號是<= d. 二者沒有區別
16. 變數和訊號的描述正確的是 b 。
a. 變數可以帶出程序 b. 訊號可以帶出程序 c. 訊號不能帶出程序 d. 二者沒有區別
17. 關於vhdl資料型別，正確的是 c 。
a. 資料型別不同不能進行運算b. 資料型別相同才能進行運算
c. 資料型別相同或相符就可以運算 d. 運算與資料型別無關
18. 下面資料中屬於實數的是 a 。
a. 4.2b. 3 c. 『1d. 「11011」
19. 下面資料中屬於位向量的是 d 。
a. 4.2b. 3 c. 『1d. 「11011」
20. ?關於vhdl資料型別，正確的是 b 。
a. 使用者不能定義子型別b. 使用者可以定義子型別
c. 使用者可以定義任何型別的資料 d. 前面三個答案都是錯誤的
21. 可以不必宣告而直接引用的資料型別是 c 。
a. std_logic b. std_logic_vector c. bit d. 前面三個答案都是錯誤的
22. std_logig_1164中定義的高阻是字元 d 。
a. xb. x c. zd. z
23. std_logig_1164中字元h定義的是 a
a. 弱訊號1b. 弱訊號0 c. 沒有這個定義 d. 初始值
24. 使用std_logig_1164使用的資料型別時 b
a.可以直接呼叫 b.必須在庫和包集合中宣告 c.必須在實體中宣告 d. 必須在結構體中宣告
25.? 關於轉化函式正確的說法是 b 。
a. 任何資料型別都可以通過轉化函式相互轉化 b. 只有特定型別的資料型別可以轉化
c. 任何資料型別都不能轉化d. 前面說法都是錯誤的
26. vhdl運算子優先順序的說法正確的是 c
a. 邏輯運算的優先順序最高 b. 關係運算的優先順序最高
c. 邏輯運算的優先順序最低 d. 關係運算的優先順序最低
27. vhdl運算子優先順序的說法正確的是 a 。
a. not的優先順序最高b. and和not屬於同乙個優先順序
c. not的優先順序最低d. 前面的說法都是錯誤的
28. vhdl運算子優先順序的說法正確的是 d 。
a. 括號不能改變優先順序 b. 不能使用括號 c. 括號的優先順序最低 d. 括號可以改變優先順序
29. 如果a=1,b=0，則邏輯表示式（a and b） or（ not b and a）的值是 b 。
a. 0b. 1c. 2d. 不確定
30.? 關於關係運算子的說法正確的是 c 。
a. 不能進行關係運算 b. 關係運算和資料型別無關
c. 關係運算資料型別要相同 d. 前面的說法都錯誤
31.? 轉換函式to_bitvector(a)的功能是 a
a. 將stdlogic_vector轉換為bit_vector b. 將real轉換為bit_vector
c. 將time轉換為bit_vectord. 前面的說法都錯誤
32. ?vhdl中順序語句放置位置說法正確的是 d 。
a.可以放在程序語句中 b. 可以放在子程式中 c. 不能放在任意位置 d. 前面的說法都正確
33. 不屬於順序語句的是 c 。
a. if語句 b. loop語句 c. process語句 d. case語句
34. 正確給變數x賦值的語句是 b 。
a. x<=a+b; b. x:=a+b; c. x=a+b; d. 前面的都不正確
35. eda的中文含義是 a 。
a. 電子設計自動化 b. 計算機輔助計算 c. 計算機輔助教學 d. 計算機輔助製造
36.? 可程式設計邏輯器件的英文簡稱是 d 。 a. fpga b. pla c. pal d. pld
37.? 現場可程式設計門陣列的英文簡稱是 a 。 a. fpga b. pla c. pal d. pld
38.? 基於下面技術的pld器件中允許程式設計次數最多的是 c 。
a. flashb. eerom c. sramd. prom
39.? 在eda中，isp的中文含義是 b 。
a. 網路**商 b. 在系統程式設計 c. 沒有特定意義 d. 使用程式設計器燒寫pld晶元
40.? 在eda中，ip的中文含義是 d 。
a. 網路**商 b. 在系統程式設計 c. 沒有特定意義 d. 智財權核
41. epf10k20tc144-4具有多少個管腳 a 。
a. 144個 b. 84個 c. 15個d. 不確定
42. epf10k20tc144-x器件，如果x的值越小表示 c 。
a. 器件的工作頻率越小 b. 器件的管腳越少 c. 器件的延時越小 d. 器件的功耗越小
43. 如果a=1,b=1，則邏輯表示式（a xor b） or（ not b and a）的值是 a 。
a. 0b. 1c. 2d. 不確定
44.? 執行下列語句後q的值等於 b 。
……signal e: std_logic_vector (2 to 5);
signal q: std_logic_vector (9 downto 2);
……e<=(2=>』1』, 4=>』0』, others=>』1』);
q<=(2=>e (2), 4=>e (3), 5=>』1』, 7=>e (5), others=>e (4));
……a． 「11011011b. 「00101101」 c. 「11011001」 d. 「00101100」
45. vhdl文字編輯中編譯時出現如下的報錯資訊
error: vhdl syntax error: signal declaration must h**e 『；』，but found begin instead.
其錯誤原因是 a 。
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